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      摘要: # 寄存器版本 在寄存器版本中,需要導入的外部文件只有`stm32`的啟動文件,也就是一個以`.s`結尾的匯編文件 可以手動為鏈接文件和目標文件創建文件夾,在配置中設置保存的目錄即可 **在寄存器版本中,需要實現`systeminit`函數,為空即可** 故:寄存器版本對項目結構的依賴性較低 # 庫 閱讀全文
      posted @ 2023-06-03 22:50 sunshineoier 閱讀(178) 評論(0) 推薦(0)
      摘要: # 解決方案 1. 首先檢查`debug`部分的其他配置是否出錯,包括芯片型號、`flash`大小、讀寫模式以及頻率 2. 檢查目錄是否存在中文 3. 修改`connect & Reset option`選項為如下模式: 主要修改為`under reset`模式 ![](https://img202 閱讀全文
      posted @ 2023-05-29 17:43 sunshineoier 閱讀(3668) 評論(0) 推薦(0)
      摘要: # 第一步 安裝keil5 [官網](https://www.keil.com/) [下載位置](https://www.keil.com/download/product/) ![下載界面](https://img2023.cnblogs.com/blog/1741739/202305/17417 閱讀全文
      posted @ 2023-05-29 17:12 sunshineoier 閱讀(981) 評論(0) 推薦(0)
      摘要: 參考書籍 軟件測試技術基礎教程 軟件測試概述 第一類測試:在設計規定的環境下運行軟件的功能,將其結果與用戶需求或設計結果相比較,如果相符則測試通過,如果不相符則視為Bug 第一類測試方法以需求和設計為本 第二類測試:強調測試人員發揮主觀能動性,用逆向思維方式,不斷思考開發人員理解的誤區、不良習慣、程 閱讀全文
      posted @ 2023-05-15 13:52 sunshineoier 閱讀(192) 評論(0) 推薦(0)
      摘要: 引言 推排序常常應用在操作系統的任務調度中,嘗試使用硬件對堆排序進行實現,在實現的過程中不使用function和tasks語法,即真·硬件實現 參考的博客 也就這一個博客有介紹 堆排序的Verilog實現 原理 ~~堆排序還需要復習一遍嗎?~~ 我肯定是要的 菜鳥-堆排序 圖解排序算法(三)之堆排序 閱讀全文
      posted @ 2023-04-19 17:40 sunshineoier 閱讀(553) 評論(6) 推薦(0)
      摘要: 卡諾圖 卡諾圖(Karnaugh map)是真值表的變形,它可以將有n個變量的邏輯函數的2n個最小項組織在給定的長方形表格中,同時為相鄰最小項(相鄰與項)運用鄰接律化簡提供了直觀的圖形工具 在數字電路中,對邏輯值的化簡常常要用到卡諾圖,而卡諾圖的化簡也常常困擾初學者 官方的化簡辦法 選自維基百科(卡 閱讀全文
      posted @ 2023-04-05 15:16 sunshineoier 閱讀(500) 評論(0) 推薦(0)
      摘要: 一步到位 github倉庫 這個超級好用,挺簡單的說QwQ 該倉庫有詳細的博客搭建主題,可以跟著教程走 ~~其實也就是把對應的CSS和JS代碼復制過來~~ 增加其他的特效和動畫 看板娘 各種動態特效 個人博客搭建 其余方式: github+hexo:需要在自己的電腦上部署相應的環境,比較麻煩 服務器 閱讀全文
      posted @ 2022-10-19 18:04 sunshineoier 閱讀(33) 評論(0) 推薦(0)
      摘要: 引言 之前都是在做嵌入式相關的內容,最近因為課程需要使用無人機,所以對收集到的無人機的學習資料進行整理 基礎術語和框架的構建 首先推薦全權老師的《多旋翼飛行器設計與控制》,前三章構建了一個對于無人機的知識框架,第4-6章會更偏向于模型的構建,比如:無人機飛行時的動力學模型之類,第7-13章更偏向于無 閱讀全文
      posted @ 2022-09-28 15:17 sunshineoier 閱讀(222) 評論(0) 推薦(0)
      摘要: 引言 因為一些額外的步驟,更改了cmdline.txt中的內容,后面樹莓派就不能正常啟動 參考的資料: 官方的文檔 默認的配置 翻譯得很爛的中文文檔 cmdline參數介紹 正題 對于這個cmdline.txt文件,主要的作用就是在操作系統啟動時傳遞參數給操作系統,從而配置一些選項,比如:把信息通過 閱讀全文
      posted @ 2022-07-16 20:47 sunshineoier 閱讀(1591) 評論(0) 推薦(0)
      摘要: 引言 該文章基于汪文祥的《CPU設計實戰》總結 豆瓣圖書 核心 Verilog編程的核心是面向硬件編程 寫Verilog就是在畫電路 面向硬件電路設計的思維: 數據通路 + 控制邏輯 CPU設計中需要遵守的規定 代碼中禁止出現initial語句 代碼中禁止出現casex,casez 代碼中禁止用#表 閱讀全文
      posted @ 2022-07-06 17:02 sunshineoier 閱讀(112) 評論(0) 推薦(0)
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