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摘要：        
1.算法仿真效果 本文是之前寫的文章 《基于FPGA的QPSK+幀同步系統verilog開發,包含testbench,高斯信道,誤碼統計,可設置SNR》 的硬件測試版本。 在系統在仿真版本基礎上增加了ila在線數據采集模塊，vio在線SNR設置模塊，數據源模塊。 硬件ila測試結果如下：（完整代碼運    閱讀全文

      


      
        
      
        
      posted @ 2025-06-11 18:05
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