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      2024年3月27日

      摘要: 模型功能 實現(xiàn)寄存器之間的連線 實現(xiàn)寄存器的聲明 建構(gòu)時鐘的時序系統(tǒng) 模型框圖 `timescale 1ns / 1ps /* */ // ******************************************************************************* 閱讀全文

      posted @ 2024-03-27 21:50 綠葉落秋風(fēng) 閱讀(290) 評論(0) 推薦(0)

      摘要: 模型功能 常數(shù)在verilog設(shè)計中具備特殊的含義 一個可以由編譯器進行處理的數(shù) 和C語言中常數(shù)一個不變的變量的作用不同 在verilog中,常數(shù)更多地作為預(yù)編譯變量以提高設(shè)計的靈活性 在上一篇文章中已經(jīng)使用的genvar i就是用于級聯(lián)變量而存在 也就是說 verilog的常數(shù)更多地服務(wù)于結(jié)構(gòu)描述 閱讀全文

      posted @ 2024-03-27 00:45 綠葉落秋風(fēng) 閱讀(211) 評論(0) 推薦(0)

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